IS41LV16100C-50TLI ISSIElectronic dynamischer Direktzugriffsspeicher integrierter Schaltungen
1.FEATURES
• Kompatibler Input und Ertrag TTLs; Tristate-Input/Output
• Erneuern Sie Abstand:
— Auto erneuern Modus: 1.024-Zyklus-/16-Frau
— Nur für RAS, CAS-vor-RAS (CBR) und versteckt
— Selbst erneuern Modus: 1.024-Zyklus-/128-Frau
• JEDEC-Standard-pinout
• Einzelne Stromversorgung:
5V ± 10% (IS41C16100C)
3.3V ± 10% (IS41LV16100C)
• Byte schreiben und Byte Lesevorgang über zwei CAS
• Industrielle Temperaturspanne: -40oC zu +85oC
2.DESCRIPTION
TheISSIIS41C16100CandIS41LV16100Care1,048,576
leistungsstarke CMOS 16-Bit-Dynamik x direkt
Gedächtnisse. Diese Geräte bieten einen Zykluszugang nannten an
Ausgedehnter Seitenmodus des Daten-Heraus-(EDO). EDO Page Mode
erlaubt 1.024 gelegentliche Zugänge innerhalb einer einzelnen Reihe mit
Zugangszykluszeit so kurz wie 30 ns pro 16-Bit-Wort. Es ist
asynchron, da es keinen Taktsignalsignaleingang erfordert
zu Befehle und Input/Output synchronisieren.
ThesefeaturesmaketheIS41C/41LV16100Cideallysuited
für hohe Bandbreitengraphiken digitale Signalverarbeitung,
Hochleistungs-EDV-Systeme und Peripherie
Anwendungen, denen ohne eine Uhr laufen Sie, um zu synchronisieren mit
das D-RAM.
Das IS41C/41LV16100C wird in einem 42 Stift 400 Mil verpackt
SOJ und Stift 400 Mil 50/44 TSOP (Art II)
PARAMETER DES TIMING-3.KEY
KONFIGURATIONEN 4.PIN 50(44) - Pin TSOP (Art II)
5.FUNCTIONAL SANTENDIAGRAMM
Beschreibung 6.Functional das IS41C/41LV16100C ist ein CMOS-D-RAM, das für Hochgeschwindigkeitsbandbreite, Anwendungen der geringen Energie optimiert wird. Während des LESENS oder der Schreibzyklen wird jedes Stückchen einzigartig durch die 16 Adressbits adressiert. Diese werden zehn Bits (A0-A9) zur Zeit eingegeben. Die Zeilenadresse wird durch den Zeilenadresse-Röhrenblitz (RAS) verriegelt. Die Spaltenadresse wird durch den Spaltenadresse-Röhrenblitz (CAS) verriegelt. RAS wird verwendet, um die ersten neun Bits zu verriegeln und CAS wird verwendet, um die letzten neun Bits zu verriegeln. Das IS41C/41LV16100C hat zwei CAS-Kontrollen, LCAS und UCAS. Der LCAS- und UCAS-Input innerlich erzeugt ein CAS-Signal, das in einer identischen Art zum einzelnen CAS-Input auf dem anderen 1M x 16 D-RAM arbeitet. Der wesentliche Unterschied ist, dass jedes CAS seine entsprechende Input-/Outputtristate-Logik steuert (in Verbindung mit OE und WIR und RAS). LCAS-Kontrollen i O0 durch I-/O7 und UCAS-Kontrollen I/O8 bis I/O15. Die Funktion IS41C/41LV16100C CAS wird durch das erste transitioning TIEF CASs (LCAS oder UCAS) und das letzte transitioning hintere HOCH bestimmt. Die zwei CAS-Kontrollen geben die IS41C16100C- und IS41LV16100C- BYTE-LESEN- und BYTE Schreibzyklusfähigkeiten. Speicherzyklus des Speicherzyklus A wird durch eingeleitet, RAS NIEDRIG zu holen und er wird beendet, indem man RAS und CAS-HOCH zurückbringt. Zu stellt richtige Gerätoperation sicher und Richtigkeit der Daten jeder möglicher Speicherzyklus, onceinitiated, mustnotbeendedoraborted vor der minimalen tras Zeit ist abgelaufen. Ein neuer Zyklus darf nicht bis das minimale Vorbelastungszeit trp, TCP eingeleitet werden ist abgelaufen. Lesezyklus des Lesezyklus A wird durch den fallenden Rand von CAS eingeleitet, oder OE, whicheveroccurs Letztes, whileholdingWEHIGH.Thecolumn-Adresse muss während einer minimalen Zeit gehalten werden, die durch Teer spezifiziert wird. Daten heraus werden gültig, nur wenn trac, taa, tcac und toea alle erfüllt sind. Infolgedessen ist die Zugriffzeit von den TIMING-Verhältnissen zwischen diesen Parametern abhängig. Schreibzyklus des Schreibzyklus A wird durch den fallenden Rand von CAS und von UNS eingeleitet, welches zuletzt auftritt. Die Eingabedaten müssen gültig an oder beforethefallingedgeofCASorWE, whicheveroccursfirst sein. Auto erneuern Zyklus, um Daten, 1.024 zu behalten erneuern Zyklen werden angefordert in jedem Zeitraum mit 16 Frauen. Es gibt zwei Möglichkeiten, das Gedächtnis zu erneuern. 1. Durch das Abstoppen jede der 1.024 Zeilenadressen (A0 bis A9) mit RAS mindestens sobald jedes tref maximale. Jedes mögliches Lesen, schreibt, Lesen-ändert-writeorRAS-onlycyclerefreshestheaddressed Reihe. 2. Unter Verwendung a CAS-vor-RAS erneuern Sie Zyklus. CAS--beforeRASrefreshisactivatedbythefallingedgeofras, beim CAS NIEDRIG halten. In CAS-vor-RAS erneuern Sie gebissenen Zähler cyclean interne 9 zur Verfügung stellt die Zeilenadressen und die externen Adresseneingaben werden ignoriert. CAS-vor-RAS ist ein nur für erneuern Modus und kein Datenzugriff oder Gerätauswahl wird erlaubt. So bleibt der Ertrag im hoch--z Zustand während des Zyklus. Selbst erneuern Zyklus, den der Selbst erlaubt den Benutzer eine Dynamik erneuert, Datenzurückhaltenmodus am ausgedehnten erneuern Zeitraum von Frau 128 d.h., 125 µs pro Reihe wenn unter Verwendung verteilten CBR erneuert erneuern. Die Eigenschaft gesteht dem Benutzer die Wahl von einem völlig statischen auch, Daten-Zurückhaltenmodus der geringen Energie zu. Der optionale Selbst erneuern Eigenschaft wird eingeleitet, durch die Ausführung eines CBR, erneuern Zyklus und das Halten VON RAS-TIEF für das spezifizierte tRAS. Der Selbst erneuern Modus wird beendet, indem er RAS-HOCH während einer minimalen Zeit von tRP.This-Verzögerung fährt, zulässt die Fertigstellung von jedem internen erneuern Zyklen, die möglicherweise im Prozess zu der Zeit des Niedrig-zu-EN-HOH Überganges RAS sind. Wenn der D-RAM-Prüfer verteilt verwendet, erneuern Sie Reihenfolge, eine Explosion erneuern wird angefordert nicht nach dem Herausnehmen von Selbst erneuern. Jedoch erneuern iftheDRAMcontrollerutilizesaRAS-onlyorburst Reihenfolge, alle 1.024 Reihen muss innerhalb der durchschnittlichen internen Bildwiederholfrequenz, vor der Zurücknahme des Normalbetriebs erneuert werden. Ausgedehnte Daten aus Seitenmodus EDO-Seitenmodusoperation ermöglichen alle 1.024 Spalten innerhalb einer vorgewählten Reihe, mit einer hohen Datenrate nach dem Zufall erreicht zu werden. Im EDO-Seitenmoduslesezyklus wird die Datenausgabe zum folgenden fallenden Rand des CAS-Zyklus, anstelle der steigenden Flanke gehalten. Aus diesem Grund wird der gültigen Datenausgabezeit im EDO-Seitenmodus verglichen mit dem schnellen Seitenmodus verlängert. Im schnellen Seitenmodus wird die gültige Datenausgabezeit, die CAS-Zykluszeit kürzer so kürzer auch wird. Deshalb im EDO-Seitenmodus, ist der Regelungsrand im Lesezyklus größer als der des schnellen Seitenmodus, selbst wenn die CAS-Zykluszeit kürzer wird. Im EDO-Seitenmodus wegen der ausgedehnten Datenfunktion, kann die CAS-Zykluszeit als im schnellen Seitenmodus kürzer sein, wenn der Regelungsrand der selbe ist. TheEDOpagemodeallowsbothreadandwriteoperations während eines RAS-Zyklus, aber die Leistung ist mit dem des schnellen Seitenmodus in diesem Fall gleichwertig. Macht-auf während Macht-auf, müssen RAS, UCAS, LCAS und WIR mit Vdd (HOCH) ganz aufspüren um Stromstöße zu vermeiden und lassen Initialisierung fortfahren. Einer Anfangspause von 200 µs wird gefolgt von einem Minimum von acht Initialisierungszyklen angefordert (irgendeine Kombination von den Zyklen, die ein RAS-Signal enthalten).
Q1. Was ist Ihre Ausdrücke des Verpackens?
: Im Allgemeinen verpacken wir unsere Waren in den neutralen weißen Kästen und in den braunen Kartonen.
Wenn Sie erlaubterweise Patent registriert haben, können wir die Waren in Ihren eingebrannten Kästen verpacken, nachdem wir Ihre Ermächtigungsbriefe erhalten haben.
Q2. Was ist Ihr MOQ?
: Wir stellen Ihnen kleines MOQ für jedes Einzelteil, es abhängen Ihr spezifischer Auftrag zur Verfügung!
Q3. Prüfen Sie oder überprüfen alle Ihre Waren vor Lieferung?
: Ja haben wir 100% Test und überprüfen alle Waren vor Lieferung.
Q4: Wie machen Sie unser Geschäft langfristiges und gutes Verhältnis?
Wir halten gute Qualität und der konkurrenzfähige Preis, zum unserer Kunden sicherzustellen fördern;
Wir respektieren jeden Kunden, da unser Freund und wir, herzlichst Geschäft zu tätigen und Freunde mit ihnen, es zu machen nicht etwas sind, der ersetzt werden kann.
Q5: Wie man mit uns in Verbindung tritt?
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